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dc.contributor.advisorPereira, Monica Magalhães-
dc.contributor.authorCardoso, Elisio Breno Garcia-
dc.date.accessioned2017-12-15T12:37:32Z-
dc.date.available2017-12-15T12:37:32Z-
dc.date.issued2017-11-24-
dc.identifier2012912339pr_BR
dc.identifier.citationCARDOSO, Elisio Breno Garcia.Sistema multiprocessado MIPS em VHDL. 2017. 62 f. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação). Departamento de Informática e Matemática Aplicada. Universidade Federal do Rio Grande do Norte. Natal, 2017.pr_BR
dc.identifier.urihttp://monografias.ufrn.br/jspui/handle/123456789/5402-
dc.languagept_BRpr_BR
dc.publisherUniversidade Federal do Rio Grande do Nortepr_BR
dc.rightsopenAccesspr_BR
dc.subjectSistema Multiprocessadopr_BR
dc.subjectMIPSpr_BR
dc.subjectPipelinepr_BR
dc.subjectVHDLpr_BR
dc.titleSistema multiprocessado MIPS em VHDLpr_BR
dc.title.alternativeMIPS Multiprocessing System in VHDLpr_BR
dc.typebachelorThesispr_BR
dc.description.resumoSegundo a Lei de Moore, a capacidade de integração de transistores dobra a cada 18 meses. Essa previsão permitiu o aumento da complexidade em projetos dos sistemas embarcados e o surgimento dos sistemas em chip, em que todos os componentes básicos de um computador são integrados num único chip. A redução da área necessária para condensar bilhões de transistores num único chip permitiu um avanço com o surgimento dos sistemas multiprocessados em um único chip (MPSoC - Multiprocessor System on Chip). Nessa abordagem, vários processadores (núcleos) estão presentes dentro de um mesmo chip. Este trabalho descreve o projeto e desenvolvimento em VHDL de um sistema multiprocessado com 2 núcleos baseados no MIPS Pipeline com 5 estágios com um conjunto de instruções reduzido. Os resultados apresentam uma avaliação de diferentes aspectos de hardware relacionados à área, memória, desempenho, comunicação, dentre outros.pr_BR
dc.publisher.countryBrasilpr_BR
dc.publisher.departmentCiência da Computaçãopr_BR
dc.publisher.initialsUFRNpr_BR
Appears in Collections:Ciência da Computação

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